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所謂目標阻抗，即在滿足負載最大瞬態電流需求、且電壓變化不超過最大允許波動范圍的情況下，電源分配網絡（PDN）自身阻抗的最大值。簡單來說，就是通過合理的電容配置，在盡量寬的頻段內保持PDN的AC阻抗低于目標阻抗,從而使電源的AC噪聲滿足要求。
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對于非理想電容的阻抗曲線，除了電容的容值，我們還需要關注兩個參數：ESR（等效寄生電阻）和ESL（等效寄生電感）。ESL加上安裝電感，和電容及ESR構成RLC串聯電路，隨著電感增大，電路諧振頻率往低頻偏移。另外，非理想電容的阻抗曲線在諧振點之后進入感性區，也就是說諧振頻率往低頻偏移的同時，電容的濾波效果變差。《電容的容值選擇及FANOUT設計（上）》
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隨著電源電壓降低、電流增大的發展趨勢日益明顯，目標阻抗值也越來越小。部分的低壓Core電源，設計目標阻抗不到10毫歐，設計難度不斷增加。如何對PDN阻抗進行優化？請點擊這里《電容的容值選擇及FANOUT設計（下）》
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電容的作用范圍稱為其濾波半徑，低頻電容的濾波半徑大，所以布局的時候可以放的稍微遠一些。單純濾波作用的低頻電容講究均勻擺放，不要扎堆布局。而中高頻電容的濾波半徑較小，需要嚴格靠近用電芯片管腳放置，不能離得太遠，要不然電容就“不起作用”了，那么，電容的濾波半徑到底是怎么回事？《電容的布局布線 - “電源加磁珠”，想說愛你不容易（上）》
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